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[求助] 为什么运放的输入不是极点

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发表于 2024-8-12 06:35:28 | 显示全部楼层
输入也有极点,输入如果rc小没有,rc大就有 ,输入c不大,主要看r
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发表于 2024-8-13 09:26:35 | 显示全部楼层


   
goodstudydayup 发表于 2024-8-12 23:04
运放输入是MOS栅极,R很大吧


R也可以不大啊,如果是前一级的输出,比如是很小的恒压源模型,输出电阻就很小啊,你可以计算一下运放接为负反馈形式的时候,运放输入引脚的输入电阻是多大
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发表于 2024-8-14 09:25:54 | 显示全部楼层


   
goodstudydayup 发表于 2024-8-13 21:33
哦,极点频率1/RC里面的R是单指电阻么,我以为是指阻抗,想着输入栅极的阻抗很大
...


理解还是不到位,单纯看栅极的输入阻抗是很大,但是这只是cmos的输入端,还要看是什么东西,给这个输入端输入信号,也就是栅极的输入信号源,如果栅极的输入信号源是个电流源就是也是高阻态,并联栅极的输入电阻,还是高阻态,如果是电压源,就是低阻态,并联栅极的输入电阻高阻态,结果就是低阻态,此时信号所得到的输入极点的频率就是很大很大啦
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