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[求助] 折叠共源共栅放大器设计问题

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发表于 2021-11-11 16:54:42 | 显示全部楼层
PMOS没有做cascode,缺点是第一级增益会下降。
假如做cascode,P9的Vgs需要大于2个vds之和,设计上的裕度可能会不够。
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发表于 2021-11-11 18:38:09 | 显示全部楼层


   
赵壮小可爱 发表于 2021-11-11 17:02
谢谢,嗯,确实,那对带宽,或者别的有什么影响么?


带宽等于gm/Cc,只要输入级功耗不变,Cc不变,带宽应该不变的。
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