LDO结构问题

敬山一休 · 发表于 2022-5-11 09:09:06

1.8v低于LDO而言你的余量是够的，主要是你的误差放大器设计在1.8v能不能够满足要求，还有就是负载范围有没有要求

敬山一休 · 发表于 2022-5-11 09:17:36

附件是外部带cap的LDO你可以参考一下他的补偿方法

敬山一休 · 发表于 2022-5-11 10:46:47

jxp2021 发表于 2022-5-11 10:33
你好。就像我上面提出的一样，如果误差是折叠式的共源共栅，那输出的共模电平最低也是2Vod（PMOS作为输入 ...

vod大概是0.2左右，vth是0.7v所以源跟随器输出最低是1.1v，我觉得还可以，可能会再高一点，我觉得还是可以做的

敬山一休 · 发表于 2022-5-11 10:52:10

功率管是可以不再饱和区的

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