时钟毛刺

fengzhepianzhou · 发表于 2011-6-1 22:25:53

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以前看过很多文章介绍时钟毛刺的消除方法，最常见的就是门控时钟的实现方法。最推荐的方法就是锁存器+逻辑与门。虽然很多时候看这个都不是asic常规手法，因为同时用到下降沿和锁存器。这两个技巧都是正常ASiC应当避免的。而现在却成为救命的法宝。
今天提到这个事情，也是因为实际项目有这个需求，当然，现在随便拿个ASIC都有这个需求。。。仿真的时候发现有问题，通过波形怎么看也看不出的问题，那就是时钟明明没有沿的到来，寄存器的输出却翻转了。这很难让人理解。当然，我们这里不是讲诡异事件，万事都有源头。根本原因是有个时钟毛刺出现了，巧巧的时他比显示精度还小的宽度，因此波形根本就看不出来。但仿真工具还是很负责的捕捉到了这个毛刺。
眼睛未必为实，还是在设计的时候多考虑些，后面调试的时间就要小很多很多

qqwang106 · 发表于 2011-6-14 09:13:13

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hurricanebomb · 发表于 2013-3-21 20:57:31

以前看过很多文章介绍时钟毛刺的消除方法，最常见的就是门控时钟的实现方法。最推荐的方法就是锁存器+逻辑与 ...
fengzhepianzhou 发表于 2011-6-1 22:25

登录/注册后可看大图

？？？？

lordlion · 发表于 2013-5-9 15:02:48

毛刺没那么可怕的，数据信号毛刺是正常的，时钟信号貌似多是分频电路和时钟选择电路造成的，已经都有了成熟的固定的处理电路的，没问题。

kakool · 发表于 2013-6-18 21:49:32

毛刺都能造成这么大的危害，那设计可靠性何在?

if1302 · 发表于 2013-6-28 09:23:57

回复 1# fengzhepianzhou

谢谢分享

jery_cn · 发表于 2013-7-20 18:52:48

latch+and gate是应该避免的设计方法？奇怪

liyikai · 发表于 2013-8-14 11:13:09

不错，时钟毛刺是需要在设计中特别注意的东西

gs2198 · 发表于 2013-9-23 15:01:50

HFWAEILIASEF

liriver03 · 发表于 2013-9-23 22:09:21

时钟毛刺还是要小心的。通常来说时钟经过的路径都是BUF/INV/MUX（选择是静态），这类cell不会产生毛刺。如果是经过了clock gating，需要有gating check保证无毛刺。如果有动态切换，切换电路保证无毛刺。

[原创] 时钟毛刺

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