IEEE 1800-2017 - IEEE Standard for SystemVerilog

dahuwei_ · 发表于 2018-6-1 16:56:15

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IEEE 1800-2017 - IEEE Standard for Systemverilog--Unified Hardware Design, Specification, and Verification Language

SystemVerilog IEEE 1800-2017.pdf.zip (8.66 MB, 下载次数: 1771 )

dcircuit · 发表于 2018-6-1 21:41:51

liangge yiyang

bestman0729 · 发表于 2018-6-29 17:11:37

谢谢分享

otod3r · 发表于 2018-7-4 14:27:02

多谢分享

puxiancheng · 发表于 2018-8-15 18:56:52

才知道sv和v的标准合并了。。。

tdh19860911 · 发表于 2018-8-24 11:26:09

谢谢分享，看标准，查标准

894438252 · 发表于 2018-8-24 11:47:18

good learn book

yzh123 · 发表于 2018-9-5 14:58:47

goodbook.thanks

yubeizr · 发表于 2018-9-7 13:59:23

最新的标准一定要收一份，不错。

koala840816 · 发表于 2018-9-12 19:33:12

Thank you so much

[资料] IEEE 1800-2017 - IEEE Standard for SystemVerilog