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查看: 4355|回复: 4

[求助] verilog中的&Cnt等于多少?

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发表于 2017-8-17 22:44:51 | 显示全部楼层 |阅读模式

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verilog中的语句  &Cnt  等于多少? &Cnt  代表的意思不是Cnt与Cnt进行位与运算吗?我的想法是Cnt为1时,&Cnt 为1 ;Cnt为0时,&Cnt 为0 ;但modelsim仿真出来的结果不是这样的。。
发表于 2017-8-18 06:41:01 | 显示全部楼层
回复 1# Crystal2015

你定义的是1'b1吗?如果不是,那当然结果也为0.
发表于 2017-8-18 11:27:42 | 显示全部楼层
如果cnt为cnt[3:0]
&cnt= cnt[0] & cnt[1] & cnt[2] & cnt[3]
 楼主| 发表于 2017-8-24 23:08:27 | 显示全部楼层
谢谢!已经明白了[img][/img]
发表于 2017-8-25 04:21:20 | 显示全部楼层
回复 3# haimo


   thanks for replying
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