TSPC中脉冲计数器和吞咽计数器

普雅花 · 发表于 2017-3-22 14:31:21

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求助各位大神。最近在学习PLL中分频器的设计，TSPC九管构成的D触发器已经完成，现在想研究吞咽计数器和脉冲计数器了。在知网和万方上都找了各种论文，但是论文里面只有基本原理的介绍，并没有详细的电路或者Verilog程序。实在头疼啊，希望走过路过的大神们帮帮忙啊！再次谢过了。

lwzunique · 发表于 2017-3-27 22:03:03

P和S是异步的计数器，通常P和S是由准静态移位寄存器实现的可load的D触发器，没有必要做成TSPC的结构，TSPC的结构主要是做PS之前的双模预分频器，比如4/5预分频器。
verilog得代码少见，具体电路还是有不少的，等我传给你。

lwzunique · 发表于 2017-3-28 08:36:44

以上文件就非常接近实际电路了，但是还一定是你所需要的实际电路。
设计的时候要要注意一下几点：1.D触发器有上升沿触发，有上升沿触发的，通常选择上升沿，别搞错了。2.延时优化要注意，对于延时的优化，通常加反相器是不好用的，常用的方法是调整load的逻辑，然后通过加D触发的形式来优化，至于怎么加D触发器，这就不好说了，具体的电路实现上有很多的调整途径，你要通过仿真，观察波形，仔细思考，多仿真，看看波形，应该就知道怎么调整了。