pll锁定时VCO的控制电压

JohnHilo · 发表于 2016-6-13 23:04:33

回复 5# 1261015620

那很难解释这突变了

sekong179 · 发表于 2016-6-14 10:15:08

回复 9# 1261015620

LC VCO，当它的控制频率的电压Vt有范围限制的时候可能出现这种情况。你们用的是LC VCO吗。若不是，我就不知道了

1261015620 · 发表于 2016-6-14 11:55:18

回复 12# sekong179

没错，是LC VCO。不过控制电压怎么会有限制呢，应该是0~Vdd都能调节的呀？

1261015620 · 发表于 2016-6-14 11:56:07

回复 10# iamshuang2013

我觉得应该还好吧，之前也仿过，也没出现这种情况~

sekong179 · 发表于 2016-6-14 14:48:39

回复 13# 1261015620

LC VCO的频率，是用电容阵列扩展的，电容阵列是由数字电路控制的，每更改一次数字，是有一个频率的，从图看大约为60us，VCO的频率控制电压，可以采用为0~VDD，但是，当电压为0或者VDD附近的时候，Kvco会变化比较大，另电流失配也会比较大，通常只取中间一段电压范围
大概要仿真等电压稳定超过60us，才可以认为PLL已经稳定了

1261015620 · 发表于 2016-6-14 15:36:45

回复 15# sekong179

没错，我们用的的确是电容阵列的LC VCO，4位控制位产生16条调谐曲线。不过我仿真的时候控制字都是固定的，当前控制字对应的调谐曲线是包含所需频率的。也就是这个过程中并不存在不同曲线之间的跳变...

1261015620 · 发表于 2016-6-22 11:05:11

有没有前辈知道这是怎么回事呢，这几天被这个问题卡了好久了

widlarfan · 发表于 2016-6-22 14:52:23

Check loop bandwidth?

1261015620 · 发表于 2016-6-22 15:48:56

回复 18# widlarfan

您的意思是vtune的突然跳跃是由于这个时候环路带宽突然发生了变化吗？比如？

luckybreeze123 · 发表于 2016-6-25 15:40:59

是不是VCO后的负载loading 效应或者VCO的电压pulling？比如VCO 的LDO的输出电压正好在这个地方有变化？

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