Bias电流最小能做到多少

zhangtaoqiqi · 发表于 2015-10-19 10:45:02

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项目需要做一些低功耗的Bandgap，LDO以及OSC等等
电路大概结构估计都是采用最简单的架构
如果暂时不考虑电阻电容之类的面积，以及选用L很大的MOS带来的面积上的增加，以及不考虑噪声等性能
这里想请教下大家，每一路bias最小能做到多小，这个和哪些因素有关呢？

谢谢

Brock · 发表于 2015-10-19 11:36:08

你说的到底是哪个模块的电流？理论上任意小都可以，但是性能不好。要看你对性能的要求才能决定多少电流是合理的

zhangtaoqiqi · 发表于 2015-10-19 12:59:36

回复 2# Brock

我想问的是，如果其他因素都不考虑，一路bias，从VDD到PMOS，经过其他device，到NMOS，再到地，能做到多小？
仿真看起来，好像是可以很小，10nA也可以
但实际上这么做会有什么风险呢?
谢谢！

zhangtaoqiqi · 发表于 2015-10-19 13:00:50

回复 3# zhangtaoqiqi

如果不考虑其他性能，包括噪声，PSRR都不考虑，只要能用，能有function就行

michang5342 · 发表于 2015-10-19 13:52:50

个人认为有几点挑战：
1. SPICE模型在低电流下的模拟数值是很不准确的。
2.要做到微安以下的低电流，要采用的MOS管的长度要很大，这时元件的模型准确度也是很不靠谱的。

semico_ljj · 发表于 2015-10-19 22:51:14

回复 1# zhangtaoqiqi

低功耗响应速度是个挑战！如果是低频，那么还是相对容易实现的。

zhangtaoqiqi · 发表于 2015-10-20 09:40:34

回复 6# semico_ljj

如果全部是低频，那最低的话，大概一路bias能做到多低呢？谢谢！

semico_ljj · 发表于 2015-10-20 19:15:22

回复 7# zhangtaoqiqi

嵌入人体内的，比如心脏的，都是nA级别的，但是它的工作频率很低，都是Hz级别，1K以上都不需要！
关键看你的需求！还有nA级别的设计，需要和代工厂多沟通，看能不能获取一些信息！
仿真有时候真的不可信了！只能看个大概，最后出来Ibias偏差100％都很可能的

nihaobuhaoa · 发表于 2015-10-21 11:09:52

回复 8# semico_ljj

我们的产品也不会嵌入体内，但是希望sleep mode下电流越低越好。。。
基本上需要一个低电流的类似于ldo一样的东西，给retention cell供电
还需要一个OSC，维持一些基本功能，但不要求准，偏差大一点没关系

如果用TSMC的工艺，typical case下，做到一路bias 30nA的量级，simulation可靠程度大吗？

semico_ljj · 发表于 2015-10-21 13:36:59

回复 9# nihaobuhaoa

TSMC仿真相对准，但是30nA级别，偏差还是很大的！这个最好和代工厂沟通！

如果你只是做研究，可以试一下，

如果是量产，最好做一些模块流片看一下实际测试参数和仿真比较如何

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