em.alf 语法问题

ershier86 · 发表于 2015-9-21 10:50:55

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在导入em rule时，2014.09版的ICC提示rule的语法有问题，rule是工艺厂商提供的，所以怀疑是icc版本问题。用2013.03版的ICC可以正常导入！那么问题来了，为什么低版本的ICC可以正常导入，而高版本的不能呢？语法一般不是向下兼容的吗？
另外，对目前的问题如何解决呢，是修改rule还是换低版本的ICC呢？谢谢

icfbicfb · 发表于 2015-9-21 11:47:03

有些高版本会对语法有新的要求，

没用过alf么，有这个必要么？

ershier86 · 发表于 2015-9-21 11:49:46

本帖最后由 ershier86 于 2015-9-21 11:51 编辑

回复 2# icfbicfb

用不用alf不是重点。主要是我想对设计加入em约束，库里面只有这个rule。不用这个rule的话，那么我怎么对设计加入em 约束呢？

icfbicfb · 发表于 2015-9-21 11:53:49

em表示没有检查过，多快的设计？

ershier86 · 发表于 2015-9-21 11:56:22

回复 4# icfbicfb

1.5G吧

ershier86 · 发表于 2015-9-21 11:57:02

回复 4# icfbicfb

用的TSMC 40nm

icfbicfb · 发表于 2015-9-21 14:42:04

这么快，是可以考虑em了， 40nm能跑这么快？

ershier86 · 发表于 2015-9-21 14:49:26

回复 7# icfbicfb

1.5G是有margin在里面的，实际设计值大概1.28G左右。
另外只有一小部分逻辑会工作在1.5G。剩余大部分工作在除频之后的时钟，大概200M。另外这个em.rule的问题，版主推荐什么样的解决方式呢？

ershier86 · 发表于 2015-9-21 14:56:55

回复 8# ershier86

另外再问版主一个问题，40nm采用DC flow多，还是DCT flow多呢？

icfbicfb · 发表于 2015-9-21 16:01:31

dct 多，如果只是一小部分在1.3g的化，那还好了，把wire width加倍就够了

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