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[原创] MIPI CSI2 Tx 和 Rx 的 IP核

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发表于 2015-1-5 10:58:59 | 显示全部楼层 |阅读模式

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本帖最后由 111_ZH 于 2015-1-5 12:10 编辑

目前,我们WWAGO公司的MIPI CSI2 的IP核,在业界处于领先位置。

我们的 CSI2 Tx (vs. other vendors)


We have a multiplexing CSI2 transmitter, which canmultiplex several data sources (e.g. 4 cameras) to a single CSI2 stream.Customers are forced to design a complex multiplexing means outside the IP core.


no other vendors have a multiplexing CSI2 transmitter.



我们的CSI2 Rx (vs. other vendors)


·   Our CSI2 Rx IP cores (inparticular the SVRPlus-CSI2) allow handling of several pixels per clock cycles;this enables the user to use slower clock frequencies


·    Our IP is the only oneto support 8-lane extended CSI2(目前全球,只有我们能提供支持8-lanes的CSI2 IP 核)


·   we are one of the only 2 IP cores with MIPI IOL certificate(全球通过 MIPI IOL认证的这个IP有2家,我们是其中一家)



 楼主| 发表于 2015-1-5 11:14:22 | 显示全部楼层
本帖最后由 111_ZH 于 2015-1-5 11:54 编辑

我们的MIPI CSI2 Tx 和 Rx,既可以用于ASIC上,也可以用于 FPGA上。有需要的可以和我们 sales@wwago-inc.com 联系。
资料如下:

MIPI CSI2 Tx

1:  4-lane MIPI CSI2 transmitter  ( SVT-CS4AP1)

WWAGO_SVT-CS4AP1.pdf (448 KB, 下载次数: 183 )

2:  4-lane MIPI CSI2 transmitter for FPGA (SVT-CS4AP1-F )

WWAGO_SVT-CS4AP1-F.pdf (459.47 KB, 下载次数: 182 )

3:  Multiplexing 4-lane MIPI CSI2 transmitter ( SVT-CS4AP2 )

WWAGO_SVT-CS4AP2.pdf (613.21 KB, 下载次数: 117 )


MIPI CSI2 Rx

1:  4-lane MIPI CSI2 Receiver for ASIC and FPGA (SVR-CSI4 )

WWAGO_SVR_CS4.pdf (740.03 KB, 下载次数: 199 )

2:  8-lane MIPI CSI2 Receiver for ASIC (SVRPlus-CSI2-I )

WWAGO_SVRPlus_CSI2_I.pdf (670.22 KB, 下载次数: 123 )

3:   8-lane MIPI CSI2 Receiver for ASIC (SVRPlus-CSI2-F )

WWAGO_SVRPlus_CSI2_F.pdf (699.5 KB, 下载次数: 99 )
发表于 2015-1-5 11:42:02 | 显示全部楼层
原创,IP核。。。。。。
广告就广告,发个广告都这么没节操!
发表于 2015-1-6 08:48:37 | 显示全部楼层
了解下!
发表于 2015-1-10 02:50:35 | 显示全部楼层
广告就广告,

Please !
发表于 2015-6-15 17:08:24 | 显示全部楼层
先顶一个看看!!!!
发表于 2015-6-16 16:14:58 | 显示全部楼层
这个,看看吧。。。
 楼主| 发表于 2015-7-29 13:06:04 | 显示全部楼层
回复 4# colindeng

详细资料,可以联系我们的sales@wwago-inc.com
发表于 2015-9-23 17:54:27 | 显示全部楼层
广告么?
发表于 2015-9-24 15:57:20 | 显示全部楼层
又不是很难的东西,吹得那么牛逼。。。
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