Verilog-A如何进入敲代码界面和仿真

jangtoy · 发表于 2014-10-16 13:19:14

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初学Verilog-A，看过一些代码,思路和语法基本的明白了，在Candence中新建一个tool为VerilogA-Editor，view默认，cell自己填，弹出的界面可以输入代码，可是没法保存或者编辑的，怎么能像C语言或Verilog或Schmetic中能看到语法报错、调试或生成symbol这样子的东西，龟求指点.

kaikanertan · 发表于 2014-10-16 13:40:30

无法调试。
如果是cadence默认的编辑器，那么是vi，利用vi的操作可保存修改等；
如果代码没有问题，保存代码后cadence会提示你是否生成symbol。

jangtoy · 发表于 2014-10-16 14:05:12

回复 2# kaikanertan

谢谢回复。
不太明白，vi也用过，好像直接在xterm中，也没有保存界面啊。听你意思，还可以用Candence外其他的编辑器？能介绍介绍么，谢谢

victor0o0 · 发表于 2014-10-16 14:27:49

回复 3# jangtoy

vi保存退出是“:wq”改编辑器在.cdsinit里加上：
editor = “xterm -e vim”
gedit可以改成你习惯的编辑器，比如gedit，emacs等

水中山0428 · 发表于 2014-10-17 20:26:22

楼主知道如何不用求导ddt来表示信号值发生变化了吗？

windwithgone · 发表于 2016-12-13 15:08:04

回复 5# 水中山0428
哈哈，谢谢啦！

zaowulanyin · 发表于 2019-7-12 11:29:14

在cadence主界面输入
editor="gedit"
然后按回车，就换了一个编辑器，这个编辑器可以点×关掉，会有提示：1、有错误，是否改错2、无错误，是否生成symbol
我刚刚遇到这个问题

[求助] Verilog-A如何进入敲代码界面和仿真

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