ICC中STD CELL显示问题

渐行渐远 · 发表于 2014-6-3 10:43:40

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为什么ICC下STD CELL只显示一个淡紫色的方框，具体的内容怎么看不见，比如有源区、NWELL、PWELL。

icfbicfb · 发表于 2014-6-3 13:05:38

打开view level， >1 ， CEL view可以看到的

渐行渐远 · 发表于 2014-6-3 15:56:18

回复 2# icfbicfb
view level>1 都是只能看见里面的一层金属

jtianen · 发表于 2014-6-4 02:36:17

淡紫色的方框是boundary，也就是cell最外面不能跟别的cell重复的地方。应该就是看不到的吧，icc不会管cell里面有什么，只是把cell连在一起吧？因为std cell在icc中是以FRAM存在的（不确定，但是定制的macro是以FRAM+.DB存在）。FRAM是跟abstract差不多的view，只有metal和pin图层在里面，其他图层应该都不会显示。

jtianen · 发表于 2014-6-4 02:39:20

补充：每次我想看route好的layout会把ICC输出的DEF 导入Virtuoso然后用一个skill脚本把abstract view转换成layout view 并label好pin，另外同时导入ICC 输出的verilog文件作为logic部分（schematic），然后在cadence里做DRC和LVS。虽然我觉得这个方法好像很麻烦但是我还是初学者，多做一些东西加深理解也还可以。。。

渐行渐远 · 发表于 2014-7-2 15:38:50

回复 5# jtianen

请问这位兄弟你也还在读书吗？

jtianen · 发表于 2014-7-3 05:40:11

回复 6# 渐行渐远

刚刚毕业

icfbicfb · 发表于 2014-7-3 13:26:20

remove_placement -obj standard

渐行渐远 · 发表于 2014-7-3 22:36:22

回复 7# jtianen
我马上也要毕业了，快找工作了，有什么建议吗？

jtianen · 发表于 2014-7-5 02:09:01

回复 9# 渐行渐远

我还没找到呢。。所以还是不要误导你啦

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