开源软核学习笔记05（继续OpenMIPS开发笔记）——2014_1_31

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回复 30# leishangwen


    仿真显示是和流水线一致的。这点没有异议。

    打个比方，现在把OpenMIPS改成单周期时序，主要把iu 中combined process 由 倒序改成 正序（其它细节忽略，如果不影响执行时间）。因为代码只是在process中变换了顺序，执行时间应该变化不大，所以从执行时间上看 应该和 单周期时序 类似。

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data hazards

凡是hazards的问题，都可以用stall来解决
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还是利用其它的课件来说明，
例如
add r3, r1, r2
sub r5, r3, r5
or r6, r3, r4
add r6, r3, r8

下一条指令需要用到上一条指令的计算结果，而上一条的计算结果要回写阶段才能写到regfile上，此时下一条指令只能等待（或其它方法forward 可以缩减等待时间）


上面的动画只显示了等待一次的状况，实际上要等到回写后，下一条指令才开始执行。

leishangwen

回复 31# oldbeginner


    简单的改变组合逻辑中的代码顺序是完全可以的，但这并不代表什么，因为组合逻辑在一个时钟过程中可能会多次进入，本身就是没有顺序的，写成那样倒序，只是为了方便阅读，也使代码更加清晰。您可以关注在时序逻辑中r的改变，r和v的一次互动，就是流水线的一次前进

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一些其它的概念
direct mapped cache
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不属于OpenMIPS内容，但是也不想另开一贴，先放在这里

cache的概念好理解，
人以群分，物以类聚。比如李将军的儿子是这样的，根据cache理论，那么宋将军的儿子将来有可能。。。。。




然后做一个动画


静态过程如下，

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cache Fully Associative 的概念
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模型如下，


然后动画，


再分成各阶段静态图























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对同样一组命令
使用 Fully Associative cache
misses : 4
hits :      7

而上一方法
使用 direct mapped cache
misses : 8
hits :      3

从命中率上可看出，fully associative cache 比 direct mapped cache 要好，

oldbeginner

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direct 和 fully 之间的cache
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模型如下，替换策略不清楚，但是有过程


过程如下，


混合cache的
misses: 4
hits:      7

同样的指令
direct mapped cache
misses: 8
hits:      3

而fully .. cache
misses: 3
hits:      8