请教一下有关IP的相关知识与运用——论坛里少有人谈论IP，特此讨论

dalingemail · 发表于 2013-12-18 12:05:11

IP附带的GDS，只是给你看看，做参考的。如果发现gds的信息和LEF中的信息不一致，就需要找工艺商咨询，以哪个为准啦。我遇到的情况是以LEF为准。

Synopsys-IC · 发表于 2013-12-19 08:34:01

回复 10# dalingemail

就是看看对应的IO口，到时候准备在外围邦PAD

Synopsys-IC · 发表于 2013-12-19 08:35:31

回复 11# dalingemail

对啊，这个如何从GDS和LEF文件来对比呢？就是两个文件如何对比查看发现问题，这个也是我后面想问的，当获取了这些文件如何去发现存在的小问题呢

shaneami · 发表于 2013-12-19 19:09:07

回复 1# Synopsys-IC

前端部分：
1. db和lib 库是在综合时使用，这没有错。其中lib是文本格式，db是design compiler使用的格式。此库中包括时序信息，以及各个PIN的DRC 约束规则，如max_transition,max_capitance,max_load等等。此库在综合时作为link_library，这样在综合时，DC就能根据这个时序库来综合与之有连接关系的其他module。同时在APR是，不管是encounter 还是icc，此库同样要吃进去，原因是APR是基于时序的。
2. .v文件用于仿真，仿真文件foudry一般也会提供。此文件中包括IP功能和一些时序的检查。

Synopsys-IC · 发表于 2013-12-20 08:43:16

回复 14# shaneami

谢谢@shaneami的讲解，前端部分的确实是这样的，不过还希望能补充完后端的讲解，有关lef的使用需要注意什么，LVS验证需要如何去做（因为foundry是给出了一个lvs的网表的，只是定义了端口），.gds.fram文件又在设计中如何使用，特别是stream in virtuoso中的时候需要有注意的问题吗？最后就是对于一个IP设计需要在后端设计中特别注意或者考虑什么？

Synopsys-IC · 发表于 2013-12-31 08:40:35

很久没人互动了，还望多多的高手来讨论交流哦

marsedes · 发表于 2013-12-31 09:08:08

你说的是IP的gds文件，这个IP的gds文件只有metal和pin的lable。我不知道别人的做法是什么我说我们这的做法，就是在dig_top.cdl 我们我也会把ip的cdl就是一个只有端口的信息cdl给lnclude进去......因为LVS BOX不检查box里面的信息但是可以检查pin....所以我们的ip的gds会导入到virtuoso....因为要保证后面的lvs的为准（相当于在check一次IP连线是否正确）....... 不管是check top.cdl还是dig_top.cdl这个方法就有效.....确保LVS OK....

jiangnaner · 发表于 2024-8-6 23:18:16

谢谢

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