DC：set_clock_uncertainty问题

jackiexiuyi · 发表于 2008-11-10 21:06:44

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请问set_clock_uncertainty -setup 0.5 -hold 0.25 [get_clocks CLK] 是什么意思？对时钟原来的setup时间和hold时间有什么影响？谢了

xinzhongdeyun · 发表于 2008-11-11 16:59:18

这个命令一般是在P＆R之前用的DC命令，由于没有确切的时钟树信息，可以用一系列的命令来描述时钟的不理想情况。uncertainty就是描述的不确定性。当进行时序分析的时候会有用到，比如算setup的时序分析时，require time 会被扣掉相应的数值，也就是说减掉相应的时间值来作一定的悲观估计。DC实际是约束驱动的，所以时序分析在综合时也是用到的。

艾清别诺 · 发表于 2011-4-6 15:14:53

学习了

raulyrx · 发表于 2011-4-8 17:39:34

解释很清楚。

花开在眼前23 · 发表于 2011-7-22 16:26:44

回复 2# xinzhongdeyun

It is amazing and nice!!!

bob-yang · 发表于 2011-7-22 17:56:20

学习一个

jn10212141 · 发表于 2012-9-20 15:41:13

set_clock_uncertainty 的值的设置有没有经验值，一般设置为多少？

Gary.wang · 发表于 2012-9-20 19:26:18

set_clock_uncertainty 不管对setup或者hold ，你可以理解为都是使情况恶略；

SKILLER · 发表于 2012-9-21 11:16:16

回复 7# jn10212141

这个只是一种与估计，在PR后会根据实际布线来抽取相应的rc参数计算延时的，所以不必太在意，当然设置大一点也无所谓，margin更大嘛，后面PR就更加轻松愉快，大的话我一般也只到一个ns左右

雷翔舞 · 发表于 2013-11-7 10:33:38

既然是时钟本身的不确定性，为何会分setup跟hold

DC：set_clock_uncertainty问题

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