【求助】如何写出place和route之后的信息？

Alicezw · 发表于 2013-11-5 15:42:01

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在ICC中如何写出place和route之后的信息，以供ECO再次读入ICC中？
谢谢大家！

Alicezw · 发表于 2013-11-6 11:05:21

求指教啊！！！

cool_lovexia · 发表于 2013-11-6 11:11:56

没有这种吧

Alicezw · 发表于 2013-11-6 11:17:23

回复 3# cool_lovexia

额。。。是吗？那如果前端代码有微小变动，如何进行ECO？谢谢！

cool_lovexia · 发表于 2013-11-6 13:22:22

本帖最后由 cool_lovexia 于 2013-11-6 13:28 编辑

把你原来的设计直接读进来，然后把你需要改动的地方进行改动。
说是这么说，但是做起来就有点复杂了。
每个公司有自己的ECO流程吧，可能方法会不一样。
你参考一下这个吧：http://bbs.eetop.cn/viewthread.php?tid=312053&highlight=eco

cool_lovexia · 发表于 2013-11-6 13:32:46

或者如果时间充足，那么就重新跑流程呗，因为你的所有脚本设置都是齐全的，重新跑一遍。

kevin9133023 · 发表于 2013-11-6 13:48:43

不就用 "write_verilog" 寫出 verilog netlist, 請 design 依照此 netlist 更改他要的電路阿.
再用 "eco_netlist" 把 design 改好的 verilog netlist 放入 ICC.

Alicezw · 发表于 2014-11-26 13:35:32

回复 5# cool_lovexia

好的，谢谢！

Alicezw · 发表于 2014-11-26 13:37:01

回复 7# kevin9133023

知道了，谢谢！

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