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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 急急急~~数字后端做lvs遇到的问题：

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查看: 4387|回复: 8

[求助] 急急急~~数字后端做lvs遇到的问题：

发表于 2013-10-23 15:44:56 | 显示全部楼层 |阅读模式

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问题如下：用calibre -lvs -hier -automatic * .rule 跑lvs，run时候报错：

source not read

到lvs错误报告里面用N多如下的错误：

Error：Wrong pin count in file “*****.cdl” at line 131 : expected 4 pins, but found 2 pins.

哪位高手指点一下，多谢了！

Count, error, expected, file, Source

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发表于 2013-10-23 15:51:09 | 显示全部楼层

看一下或許是個兩端元件你的POWER GROUND是不是沒DEFINE在netlist裡

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楼主| 发表于 2013-10-23 16:02:25 | 显示全部楼层

回复 2# chyauchyau

怎样在netlist里面DEFINE?

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楼主| 发表于 2013-10-23 16:05:18 | 显示全部楼层

回复 2# chyauchyau

我在saveNetlist的时候，加上了-includePowerGround 这一项，不知道你是不是指的这里DEFINE？

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发表于 2013-10-23 16:32:27 | 显示全部楼层

是的轉出來時要有待POWER INFORMATION

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发表于 2013-11-1 09:30:55 | 显示全部楼层

回复 1# 无忧草

就是你用的那个source文件中的某一个单元的pin个数对应不上

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发表于 2013-11-1 18:24:50 | 显示全部楼层

你读的那个cdl网表里定义了4个，但是在你source的网表里只有两个，很可能是楼上说的VDD,GND没有定义，打开网表比较着看，自然知道少的是哪两个了，我们在这里猜也不是办法！

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发表于 2020-3-15 12:10:36 | 显示全部楼层

生成的GDS需要收到打lable吗？还是用这种POWERGROUND的意思就是自动会给GDS版图打了lable

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发表于 2020-3-27 11:10:53 | 显示全部楼层

这个是网表的对应问题，建议先检查子网表与top调用是否匹配，常见VDD GND因为没有出pin导致对应不上

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