请问，UVM中的port与export可否跨层相连？

oscillator_cn1 · 发表于 2013-7-18 11:04:56

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各位：
才开始学着使用UVM中的各种port，现在情况是这样，一个顶层tb中有两种env，比如apb_env和video_env。我需要把这两个env中driver的数据都送到reference model中去处理，因此，reference model应该是跟tb平级的组件。这样相连的话，对于这些port和export来说，都跨层了。我是否可以直接在test中写“tb0.apb0.master.driver.send_apb_port.connect(ref_model.send_apb_port)"？还是我需要一层一层，分别在apb_master_agent，apb_env上都加上该port，然后再逐层相连？

nativeda · 发表于 2013-7-20 21:10:14

在test中就直接连吧。如果是在top env里，就最好不要直接使用driver里的方法和属性了

tbb2009 · 发表于 2013-7-21 12:11:33

各位：
才开始学着使用UVM中的各种port，现在情况是这样，一个顶层tb中有两种env，比如apb_env和vide ...
oscillator_cn1 发表于 2013-7-18 11:04

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没有跨层连接过，一般都是top层下面的a.port.connect(b.export),a和b里面也都是一层一层连接起来的，用connect或者直接用=

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