请问一个die中可以同时使用9T跟12T的STD吗？

hongzhiliao · 发表于 2013-2-26 12:54:02

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请问一个die中可以同时使用9T跟12T的STD吗？比如不同的block使用不同T的standard cell.

iuqq205 · 发表于 2013-2-26 13:12:29

可以的

hongzhiliao · 发表于 2013-2-26 13:19:06

回复 2# iuqq205

谢谢啊，请问下这样做在制作过程有什么特殊的要求吗还是跟同样T的chip一样的做？

ic小顽童 · 发表于 2013-2-26 13:19:31

当然可以注意powerplan

iuqq205 · 发表于 2013-2-27 10:18:19

回复 3# hongzhiliao

同一个制程的没问题的。9T区域和12T区域留点距离不会出底层的VIOLATION就可以了。

chanshi634 · 发表于 2014-1-22 16:30:27

回复 5# iuqq205

请问9t 12t分别是指什么啊

damonzhao · 发表于 2014-1-22 17:50:21

回复 6# chanshi634

指的走线的track

stdcell的高度可以按照走线的track来区分，7t/9t/12t就是指的不同的单元高度，layout的面积不同，也涉及到走线的难度问题

yueluofenghen · 发表于 2014-1-23 09:32:18

回复 7# damonzhao

有个问题，，9T和12T的应该是不同的库，有不同的tf，这个怎么一起读进去呢？

damonzhao · 发表于 2014-1-23 09:59:55

回复 8# yueluofenghen

不同的tf取决于你用几层Metal绕线，跟你用的ref library是9T还是12T没关系。

yueluofenghen · 发表于 2014-1-23 11:14:23

回复 9# damonzhao

是我没有说清楚，我用到的工具是encounter，也就是说9T的是一个lef，12T的是一个lef，9T和12T库中的cell名字是不一样的（12T库的后缀是12T）这两个想来都应该读进去，但是其中的site等等信息是不一致的。我尝试过将两个lef合成一个，可以读进去，但是新的问题是12T的库中的cell的timing信息（。lib）完全没有被识别（可能是9T的先读进去的缘故）。

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