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[求助] 每支路只有几十nA电流的LDO设计问题

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发表于 2012-3-19 21:15:47 | 显示全部楼层 |阅读模式

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请教一下,要设计一个低电流的LDO,无负载时IC静态电流3uA,这样每支路的电流就只有20-30nA左右,请问有做过的前辈,这样小的MOS管电流到时工作会正常吗,因为之前的设计都是没支路1uA以上。
发表于 2012-3-19 22:06:26 | 显示全部楼层
你的设想有问题!即使总静态电流只有1uA,也可以保证每支路Ibias=100nA。
发表于 2012-3-19 22:08:29 | 显示全部楼层
电路工作没有问题,就是瞬态响应和PSRR差一点,就看你用在哪里了。有过这种例子,带载不超过10mA,一般用用还可以。100mA以上的就免了吧,不太实用
发表于 2012-3-19 23:25:09 | 显示全部楼层
见过一个spec,静态1uA,输出200mA,不明白用在什么方面的,照说效率也不高啊
发表于 2012-3-19 23:40:41 | 显示全部楼层
回复 4# guang3000

有这样的论文倒要看看!
不过确实不实用,100mA以上的都会采用DCDC,LDO的效率是在太低了。
发表于 2012-3-20 00:17:18 | 显示全部楼层
低功耗设计工艺必须稳定,耗尽管经常使用在这类设计中,bias很小电流。
但是漏电必须控制住,需要做隔离式器件。
发表于 2012-3-20 08:31:50 | 显示全部楼层
20nA-30nA的也是可以的,普通CMOS,大部分管子进入亚阈值区,最好有失配参数跑montecarlo来保证范围。我们用过9nA的,有产品。
不过你枝路是太多了。什么结构啊?
发表于 2012-3-28 09:28:14 | 显示全部楼层
本帖最后由 guang3000 于 2012-3-28 09:36 编辑



不是论文,是人家反向的一个芯片

1u LDO.pdf (1 MB, 下载次数: 3006 )
发表于 2012-3-28 09:42:00 | 显示全部楼层
看看,谢谢版主了,
发表于 2012-3-28 11:13:42 | 显示全部楼层
看过,谢谢版主
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