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用vcs对RTL编译通过;
RTL中挂接的是Xilinx库;
但是执行./simv时有时会出现以下警告,并且卡死在这里,只能用finish命令停下来:
WMN WARNING warning: For FSM ** in module ?? ,too many illegal states were monitored ,most likely,an incomplete FSM is extracted because of coding style lease use -cm_fsmcfg tomodify the FSM;
**代表某个信号;??代表某个模块名
我的理解是:该模块中的FSM写的有缺陷。可问题是,RTL挂Xilinx的库时并不是所有的case测试都有这个问题,有一部分有;
并且如果RTL挂foundry提供的库虽然该警告仍然出现,vcs不会卡死且不影响正常测试!
是否可以怀疑VCS本身的bug?
求解,请谅解不能提供代码 |
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