CTS balance

tonyhard

今天做CTS，在common_cts文件中，设定了balance group。大概有10几个时钟，希望CTS自动执行时，可以进行balance。
不过几次执行后，总是有几个时钟不能很好balance。

原因不明。

已经从如下方面进行了分析：
（1）是否设定了特殊bounds.导致不能balance.
（2）是否设定了特殊的don't touch，导致不能balance。
（3）是否place后，占有率已满。
。。。

都确认了。可是仍旧是balance效果不好。
郁闷中。哪问高手遇到过同样的问题？可否共享一下经验？

八部众生

估计你的时钟路径上有分频器或者门控，这对于CTS是非常致命的。

CTS会默认将所有的sink都balance，但是你不妨画一下clock的逻辑结构，如果存在分频器或者CG单元，这里是无论如何也无法balance的，因此需要将这里设置为through pin

tonyhard

谢谢你的专业回复。我们的design里，通常只设定Excludepin，leaf pin。还没有设定过through pin的经验。。。另外，可以简单介绍一下分频器跟CG单元么？ 我是做后端的，对前端的逻辑不是很了解。这也是执行CTS的一大障碍。呜呜呜。

多谢了。

tonyhard

你说的分频器及门控指的是逻辑中的latch，Gated clock吧？

陈涛

比较下CTS的report和timing report，看看clock的延迟是否一致

做后端可以不清楚设计的逻辑，但是多花点时间了解clock的结构还是很值得的

chris_li

你说的分频器及门控指的是逻辑中的latch，Gated clock吧？
tonyhard 发表于 2011-7-27 23:01

                               
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CG不用解释了吧， library就有。

divider是电路搭出来的， 比如一个最简单的二分频， 用一个FF输出Q端接一个INV反馈到输入D

tonyhard

谢谢大家的热心回复。

》CTS的report和timing report
大师可以清楚地解释一下CTS的report与timing report的区别么？

我只是一个初学着，刚接触CTS不久。
我理解的是timingreport，只用户模式下的reports。或者说是芯片工作模式下的定义的钟的report。而cts report，是只CTS阶段定义的时钟的report。
CTS定义的钟，与用户模式下定义的钟，应该不同。时钟定义点以及钟的数量是不同的。
这样理解对吧？

ICC在不同模式下报report，是需要读入不同模式下的senario的。对吧。

今天分析了一天仍旧没有解决问题。问了一些公司里的工程师，都没有好的建议。ICC进行balance，会考虑很多因素。有时候一些无关timing的问题，也会影响balance的效果。比如说VoltageArea设定的问题等等。

明天周末，还需要在Debug一下.郁闷中.

tonyhard

回复 1# tonyhard
今天又去搞了半天ICC。主要是研究了一下LOG。发现在时钟数balance时出现Warning.主要内容是incorrect routing rule。可是在环境里查了半天，cts相关的设定似乎都没有问题。。。

郁闷中。。。

tonyhard

今天又做了如下尝试
(1)去掉一个最不可balance的时钟，发现其余时钟依旧不能balance。
(2)只定义两个钟，以及这两个钟的ExcludePin ，再把它们设为balance Group。这样也不行。
真是没有办法了。
哪位高人有好的见解？

jackynyc

你吧两个clock 的sink report 出来，然后挑最差的，看看timing report，然后分析下clock path 为什么不能balance。如果不是design 问题就是 constraint & tool 的问题来