如何查看wire load model？

Tonyhai · 发表于 2011-5-28 18:25:24

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本帖最后由 Tonyhai 于 2011-5-29 06:22 编辑

用report_design
report_wire_load

都不能报出，显示“No wire loading specified”

陈涛 · 发表于 2011-5-29 08:30:57

report_lib

Tonyhai · 发表于 2011-5-29 11:18:09

回复 2# 陈涛

也是同样的结果，No wire loading specified .

我用的是smic库，同样的命令对TSMC库是可以的

陈涛 · 发表于 2011-5-29 12:20:16

难道真的是lib有问题？！

shehuang1987 · 发表于 2011-5-29 15:22:33

smic有些库里面不知为什么就是没有wire load

ouyds001 · 发表于 2011-6-1 20:04:06

回复 1# Tonyhai
很大可能是你没有把库文件load进来，DC是在读入设计时把把library load 进来。你可以试下读入设计之后再用上述命令

Tonyhai · 发表于 2011-6-1 20:59:45

回复 6# ouyds001

我是在跑完综合后，再用report_wire_load的，而且我用list_lib是可以把读入的库列出来的。

caohua1986517 · 发表于 2013-4-26 16:21:21

或许lib就真的没给这个信息！

esign · 发表于 2024-12-30 17:18:10

tsmc 的 lib 有，smic 的确实没找到

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