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楼主: carefree

后端高手是什么样子?

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发表于 2010-7-2 22:46:01 | 显示全部楼层
后端么就是做从verilog代码到tapeout的
好像做前端钱比较多吧
发表于 2010-9-11 20:20:49 | 显示全部楼层
谢谢分享啊
发表于 2010-9-15 14:57:59 | 显示全部楼层
领教了,强人太多了/。
发表于 2010-9-15 15:01:07 | 显示全部楼层
俺要努力学习!
发表于 2010-11-16 20:57:18 | 显示全部楼层
[img]Sorry I can't key in Simplified Chinese
You may refer to TSMC reference flows, that is most advanced ASIC design flow

Be able to handle
10+ millions instances SOC designs
hierarchical planning and analysis
DFT knowledge and deal with boundary scan, core test, memory bist, compression scan chains
DFM knowledge and deal with metal density, dummy metal fill, virtual CMP to timing, lithography & routing
handles Low Power , power off, voltage frequency scheduling with multi-corner, multi-mode
handles Signal integrity, crosstalk & electron migration issues
handles power spec. to floorplan, i.e. voltage drop, power noise, SSO, decoupling cap, well tap etc.
handles on-chip variations, with gated clocks, and state-retantion filpflops
handles special circuits, such as analog, high frequency or RF, DDR, differential pair signal

If you are good at above topics, you may start to implement TCL or C (with APIs) to deal your own back-end problems, refer to most CAD labs research topics in the university.[/img]
请问什么样得电路才算是10+millions呢?比如手机baseband chip 算不算?目前比较流行得LTE芯片呢?这些是不是10+millions ?
望知情人解惑!
发表于 2010-12-2 22:18:32 | 显示全部楼层
本想回复,一看4楼的朋友的回复,当下羞愧。
不过,我这里多提一条。
对于用软件实现自动化操作的能力也是非常重要的。
脚本大家都能写,但是,如果能让你的脚本效率高。除了实践经验外,
对于程序的架构的理解也非常重要。
同样达成一个时序目的,根据我的经验,优化过的脚本,可以比没优化的脚本至少快30%。
在大型设计,以及提供团队脚本复用方面,这点比较有意义。
发表于 2010-12-3 02:09:19 | 显示全部楼层
goooooooooooooood
发表于 2010-12-3 11:09:41 | 显示全部楼层
牛人真多,受教了~
发表于 2010-12-16 02:56:23 | 显示全部楼层
努力啊~~~~
发表于 2010-12-16 21:38:48 | 显示全部楼层
后端的路不好走哇
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