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[原创] formality中遇到unmatch的问题,请高手指点下

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发表于 2010-7-17 21:02:19 | 显示全部楼层 |阅读模式

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门控时钟unmatch是不是不用理啊,只要verify正确就可以吧?请高手指点下哈!
谢谢!
在线等啊。。。。
发表于 2010-7-18 12:11:46 | 显示全部楼层
什么叫门控时钟unmatch?  这个时钟是不是连接到了register时钟端口了? 你要检查一下register的输入端是不是match,ummatch是要解决的。
 楼主| 发表于 2010-7-19 09:32:57 | 显示全部楼层


什么叫门控时钟unmatch?  这个时钟是不是连接到了register时钟端口了? 你要检查一下register的输入端是不是match,ummatch是要解决的。
yohuang 发表于 2010-7-18 12:11


谢谢楼上的指点,但是我还是不明白,时钟肯定是连到了寄存器的时钟端口上的,但是就是检查match的时候,这个寄存器没有mstch上,但是最后验证的时候确实对了的!
那么这个寄存器应该怎样设置检查match or unmatch呢?谢谢了
 楼主| 发表于 2010-7-19 21:14:25 | 显示全部楼层
高手说下噻...
发表于 2010-7-30 09:51:53 | 显示全部楼层
very good
发表于 2010-8-18 15:22:34 | 显示全部楼层
在PostProcess中都会提醒你共有哪些unamtch point,哪些要关心,哪些culled。
一般说来,门控latch不用关心。
是在不放心跑下lec看看结果如何。
发表于 2010-8-19 16:13:36 | 显示全部楼层
门控时钟的unmatch可以不用管,在verify时默认情况下不对使用clock gating的设计部分进行验证。如果需要对clock gating设计部分进行验证,可以使用verification_clock_gate_hold_mode命令,默认为none, 即不对使用clock gating的 设计部分进行验证,可选其他值有low, high, any,分别设定clock gating不工作时输出的clock值为低,高,低&高。
发表于 2010-8-22 03:07:27 | 显示全部楼层
学习学习。
发表于 2010-8-22 18:58:28 | 显示全部楼层
虚心的学习之。
发表于 2010-9-25 01:56:50 | 显示全部楼层
果然七楼是高手
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