讨论一下怎么优化buck converter的死区时间？

xikang · 发表于 2010-1-16 20:00:35

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buck converter,pwm mode时，上下管的死区时间怎么优化呢？
需要考虑什么因素？
上次面试被问到，我没说出个所以然来，请大家不吝赐教
谢谢谢谢谢谢

zhanweisu27 · 发表于 2010-1-16 22:20:28

太大,效率降低
太小,功耗增大
通常10~30ns吧,这还咋优化呢

xiayixue198402 · 发表于 2010-1-18 09:49:40

这个问题莫名其妙。
死区时间无非是根据你自己产品的需求定的，而且只要在合理范围内即可。是不是问电路的优化阿？
也许是我理解不了海龟的高深思想

pol_sky · 发表于 2010-1-18 12:24:12

死区时间太大，功耗会大，所以要调整上下管子的导通时序，一般会设计一个较小的时间差，在此时间段内两个管子都不通，一般会取15ns左右，太大会导致偕波振荡。

st912458 · 发表于 2010-1-29 14:48:42

看規格決定還有你的需求

cicixu · 发表于 2011-11-16 19:47:01

死区时间太大，功耗会大，所以要调整上下管子的导通时序，一般会设计一个较小的时间差，在此时间段内两个管子都不通，一般会取15ns左右，太大会导致偕波振荡

Evanpeng · 发表于 2011-11-17 07:51:44

buck converter,pwm mode时，上下管的死区时间怎么优化呢？
需要考虑什么因素？
上次面试被问到，我没说出 ...
xikang 发表于 2010-1-16 20:00

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这是个非常重要的问题！！！首先，我们是希望zero-voltage switching或者zero current wstiching
其次，我希望x点的上升和下降期间，两个mosfet同时关断。这个是被Cx和Rx所决定。
这就是adaptive dead time

mouseliu · 发表于 2012-7-12 23:15:27

这个问题还没好好想过，mark一下

semico_ljj · 发表于 2012-7-13 19:50:35

很期待。。

zgg · 发表于 2012-7-15 10:16:36

死区时间太大，功耗会大，所以要调整上下管子的导通时序，一般会设计一个较小的时间差，在此时间段内两个管 ...
pol_sky 发表于 2010-1-18 12:24

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学习了

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