[求助] 咨询一下折叠式运放的PSRR优化

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发表于 5 天前 | 显示全部楼层 |阅读模式

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在折叠式运放的运放主体电流镜中，NMOS Vgs节点的PSRR在5V电压域恶化至60dB左右，如果将PMOS进行自偏置连接，该节点PSRR可提升至-110dB；

但是在3.3V电压域下，两种连接方式的PSRR均在-105dB左右，没有较大差异，从公式计算角度并不能解释该现象；

可能会是什么原因导致的5V电压域PSRR恶化？

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