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查看: 777|回复: 5

[讨论] 网表和代码一起综合

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发表于 2025-2-19 16:49:09 | 显示全部楼层 |阅读模式

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网表和代码一起综合,是不是可以在file list上加入ddc文件??还有unmapped ddc和ddc有什么区别??
发表于 2025-2-19 17:59:56 | 显示全部楼层
可以直接读取ddc文件的,有对应命令read_ddc,unmapped的应该是基于map前的网表产生的ddc,还没有映射成std库里面的器件,里面还是getch_and2这种基本模块的getch网表。
 楼主| 发表于 2025-2-24 15:32:07 | 显示全部楼层


mgc455 发表于 2025-2-19 17:59
可以直接读取ddc文件的,有对应命令read_ddc,unmapped的应该是基于map前的网表产生的ddc,还没有映射成std ...


把ddc文件直接加到file list吗
发表于 2025-2-25 16:01:31 | 显示全部楼层


scutlee 发表于 2025-2-24 15:32
把ddc文件直接加到file list吗


不用添加到filelist,单独在综合脚本中用read_ddc命令就行。所有设计读入后用link命令,工具自己会找对应的design
 楼主| 发表于 2025-3-4 16:10:25 | 显示全部楼层


robin0612 发表于 2025-2-25 16:01
不用添加到filelist,单独在综合脚本中用read_ddc命令就行。所有设计读入后用link命令,工具自己会找对应 ...


那ddc会替代掉对应模块的rtl吗???rtl需不需要修改
发表于 2025-3-7 16:30:41 | 显示全部楼层


scutlee 发表于 2025-3-4 16:10
那ddc会替代掉对应模块的rtl吗???rtl需不需要修改


如果RTL中存在跟ddc一样的design,最好将其删掉。

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