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查看: 441|回复: 7

[求助] signal em issue

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发表于 2025-2-19 10:19:15 | 显示全部楼层 |阅读模式

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em大面积出现在clock net上的原因是啥吗?violation net的频率都在1.5G,violation net的fanout大约在30多一点(fanout都是ICG cell,驱动都在D4左右)


                               
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发表于 2025-2-19 15:39:02 | 显示全部楼层
可能是fanout太多了吧
发表于 2025-2-19 16:59:44 | 显示全部楼层
或者是cell太集中?插眼等更新
 楼主| 发表于 2025-3-26 14:29:17 | 显示全部楼层

signal em issue ---已解决

@sunhongwei,感谢大哥的回复。时间有点久了,现在close这个话题
发表于 2025-4-1 14:34:34 | 显示全部楼层
怎么解决的
发表于 2025-4-1 16:18:11 | 显示全部楼层
长直导线太长,打断或者用折线
 楼主| 发表于 2025-4-3 11:35:07 | 显示全部楼层


解fanout真实有效,就是有点影响clock tree的时序。需要再修一轮eco

 楼主| 发表于 2025-4-3 11:39:23 | 显示全部楼层


zhaozhety 发表于 2025-4-1 16:18
长直导线太长,打断或者用折线


load 分布距离driver都挺近的,net 单个分支的长度也不超过100um,分析原因还是driver 是个大buff 驱动且loads 过大,导致电流密度较大。降低fanout后,这条net的vio就消失了
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