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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 小弟在做一个TDC，现在粗计数用同步计数器做，但是发现 ...
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查看: 397|回复: 6

[求助] 小弟在做一个TDC，现在粗计数用同步计数器做，但是发现一点问题

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swucc2023
发表于 3 天前 | 显示全部楼层 |阅读模式
200资产
我想的是START来的时候，时钟沿开始计数。STOP来的时候把计数值锁存住，但是仿真发现STOP离计数器参考时钟上升沿太近的时候，会锁存出错，如图，本来应该锁存QIN0为0，但是由于计数器D触发器的延时导致锁存住了上一个时钟沿计数的1，想着调D触发器将延迟减小，但是感觉仍然会出现这种情况，有佬能解惑一下吗 屏幕截图 2025-02-17 203012.png

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swucc2023
 楼主| 发表于 3 天前 | 显示全部楼层
:)
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adhylin
发表于 前天 08:06 | 显示全部楼层
Start Stop用时钟下降沿产生，计数器还是上升沿；
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swucc2023
 楼主| 发表于 前天 08:42 | 显示全部楼层


adhylin 发表于 2025-2-18 08:06
Start Stop用时钟下降沿产生，计数器还是上升沿；


粗计数的START和STOP不是外部给的吗
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迷路大脸猫
发表于 前天 11:08 | 显示全部楼层
本帖最后由 迷路大脸猫 于 2025-2-18 11:16 编辑

都是这样的。
除非是理想DFF，不然有点亚稳态都会在边沿不准确。
很多论文都提出了解决办法，比如上下边沿同时采样，通过下一级数据来筛选；等。
EETOP创芯人才网简历投递入口
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swucc2023
 楼主| 发表于 前天 15:24 | 显示全部楼层


迷路大脸猫 发表于 2025-2-18 11:08
都是这样的。
除非是理想DFF，不然有点亚稳态都会在边沿不准确。
很多论文都提出了解决办法，比如上下边沿 ...


是的，好像有这种，上下边沿采样的
EETOP创芯人才网职位发布入口
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swucc2023
 楼主| 发表于 前天 17:10 | 显示全部楼层


迷路大脸猫 发表于 2025-2-18 11:08
都是这样的。
除非是理想DFF，不然有点亚稳态都会在边沿不准确。
很多论文都提出了解决办法，比如上下边沿 ...


请问您也是做TDC吗
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