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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 运放仿真考虑
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查看: 353|回复: 5

[求助] 运放仿真考虑

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狂澜
发表于 2024-12-13 13:23:12 | 显示全部楼层 |阅读模式

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最近发现有些仿真运放增益与稳定性上，有人连接成下图



通过仿真环路稳定性 STB的方式去仿真运放增益、PM。

这里有疑问，这样对吗？

我既然做出了一个运放，在确定了负载电容等一系列参数后。不应该只需要进行AC仿真即可得到增益、PM吗？

把运放应用到具体的电路中后，再去仿真环路的稳定性，这时用stb才是正确的。

我的理解是这样。

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jyyuan
发表于 2024-12-13 13:37:31 | 显示全部楼层
这样接可以看运放闭环增益和相位裕度吧
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xuwenwei
发表于 2024-12-13 13:43:25 | 显示全部楼层
你用的时候都是接成闭环去用的啊 stb仿真和ac仿真是一样的 没什么问题啊
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迷路大脸猫
发表于 2024-12-13 17:33:33 | 显示全部楼层
本帖最后由 迷路大脸猫 于 2024-12-13 17:43 编辑

新手才用ac。
首先，这样接已经是运放加入到环路中能表现的最差的相位裕度了，因为β<=1。
并且，这样接不仅可以仿stb，还可以仿vos、PSRR、CMRR、等效输入噪声，失真，输入输出范围。
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狂澜
 楼主| 发表于 2024-12-13 18:19:41 | 显示全部楼层
如图，此3种电路都是用来仿真开环增益的
35A117@FTGRU9~EXLA7V$6D.png
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狂澜
 楼主| 发表于 2024-12-13 18:20:38 | 显示全部楼层


迷路大脸猫 发表于 2024-12-13 17:33
新手才用ac。
首先，这样接已经是运放加入到环路中能表现的最差的相位裕度了，因为β ...


对吧
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