全差分运放的噪声仿真

Hyacinth.L · 发表于 2024-11-8 11:46:51

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本帖最后由 Hyacinth.L 于 2024-11-11 09:39 编辑

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根据《CMOS模拟集成电路设计与仿真——基于IC617》一书搭的电路，下图是书上的实例

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仿真出来
反而是输入的幅度比输出大，输出的噪声是nV，输入噪声到了kV，不知道为什么会出现这种情况，请教各位大佬

Hyacinth.L · 发表于 2024-11-8 11:48:59

下面是仿真出来的direct plot画出的图像，不知道为什么反而是output noise是nV/hz的量级，和input好像反过来了

Hyacinth.L · 发表于 2024-11-8 17:55:49

本帖最后由 Hyacinth.L 于 2024-11-11 09:38 编辑

顶一顶，求各位大佬解答

[求助] 全差分运放的噪声仿真