polas gate timing delay error

dreamflying61 · 发表于 2024-9-12 15:13:32

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在跑polas gate timming delay时出现错误，there are extra pin position definition for cell mn12。

起初跑出来mn12只有3个pin，尝试增加了model config file。

写的model config file如下：

<mn12>
PINPOSITION D 1
PINPOSITION G 2
PINPOSITION BS 3
PINPOSITION ISO 4
PINPOSITION PSUB 5

Kalkula · 发表于前天 19:31

看起来是pin和spice model不匹配，试下pinmap2model

[求助] polas gate timing delay error

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