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[求助] 单bit信号控制输出二或四分频的实现方法问题

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发表于 2024-9-4 23:31:39 | 显示全部楼层 |阅读模式

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由Freq_Div_I控制Clk_D3_L输出二分频或四分频,从前后端、时序角度分析下面那种方式较好,请教下各位前辈,由于工艺限制,400m的时钟比较高,所以想400m的分频路径处理的时候小心一些,题目中的功能我用下面的四种方式实现并综合,发现结果最后一种时序最好,但是怕用400m作为时钟,判断200m的条件会不会有不稳定因素,各位前辈有什么建议。谢谢!






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