layout xl 源漏共接不能自动吸附

weiyujie429 · 发表于 2024-7-16 13:36:50

yeshaoxiangshen 发表于 2024-7-16 11:22
重新拿个新的cdsenv 文件加载下试试

能麻烦您细说一下吗？

Pinepine · 发表于 2024-7-16 16:23:57

abut server 勾上就可以了，shift+e里面

刚会飞的菜鸟 · 发表于 2024-7-16 16:25:43

台积电0.18工艺？？

刚会飞的菜鸟 · 发表于 2024-7-16 16:27:53

本帖最后由刚会飞的菜鸟于 2024-7-17 16:18 编辑

台积电0.18工艺？？

weiyujie429 · 发表于 2024-7-24 10:25:02

Pinepine 发表于 2024-7-16 16:23
abut server 勾上就可以了，shift+e里面

你好，勾选了但是还是不行

weiyujie429 · 发表于 2024-7-24 10:26:17

刚会飞的菜鸟发表于 2024-7-16 16:27
台积电0.18工艺？？

是的

刚会飞的菜鸟 · 发表于 2024-7-26 16:27:16

weiyujie429 发表于 2024-7-24 10:26
是的

我感觉是pdk的问题，没装好，我上个项目也是这个工艺，也出现这个问题，但是我在其他项目试验，同样的工艺，没有这个问题。至今也没有找到问题

yeshaoxiangshen · 发表于 2024-8-14 10:42:45

用原始的cdsenv替换下你的

真诚的小鲸鱼 · 发表于 2024-11-19 08:54:50

感谢分享

ppicq · 发表于 2024-12-30 15:28:45

可以试一下在电路里q一下这个mos，检查一下multiplicity跟number of gate finger，你要是前者是2调出来在layout里就是合并的，你要是后者是2，在layout里调出来就是2个独立的

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