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[求助] CTDSM current steering DAC 设计

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发表于 2024-6-28 10:11:41 | 显示全部楼层 |阅读模式

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各位前辈,小弟在设计CT DSM DAC时,遇到几个问题,求各位前辈指教

1.一般论文里都关注低频输出阻抗,可是寄生电容导致的高频输出阻抗下降同样会引起动态性能变差,请问各位前辈在设计时如何考虑这点?
2.complementary 结构仿真时P端输出阻抗与N端输出阻抗不一致,大约Zoutp(DC)=3Zoutn(DC),请问这对DAC性能有影响吗?
3.如何仿真CT DSM中DAC的动态性能?负载应该接什么

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