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[求助] Pr verilog求助

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发表于 2024-5-23 15:33:09 来自手机 | 显示全部楼层 |阅读模式

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请问 .v中,这种格式是对的吗,PR报的illegal Insts name。模拟电路用NC -verilog 中导出的网表很多这种
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 楼主| 发表于 2024-5-23 15:34:09 来自手机 | 显示全部楼层
大图
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发表于 2024-5-23 15:54:03 | 显示全部楼层
inst name中不能有"[]",建议换成:
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