参数提取后发现BJT的三个引脚悬空

bryan一点锋芒 · 发表于 2024-4-23 10:48:20

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使用的是站内一个smic180OA的工艺库，
导入bjt版图的时候会提示如下

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版图中bjt是正常的，也有对应的BCE端口可以连接，不过画版图过程中不会提示与bjt相关的连线，
完整的电路图drc可以过，lvs也可以过，！上面说到版图连线不会提示与bjt有关的连线，但是lvs验证时是会进行相关验证的（因为我当时就漏了几条线没连，出现了报错）
参数提取的部分截图如下

这些全是有关BJT三个引脚的悬空警报

bryan一点锋芒 · 发表于 2024-4-23 10:50:23

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bryan一点锋芒 · 发表于 2024-4-24 17:37:55

今天检查了一下cellmap文件，发现引用的那个BJT端口正好没有定义，加了定义之后提取结果正常了，不过后仿的结果有点异常，电路都不正常工作了

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