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[求助] latch up问题

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发表于 2024-2-2 11:33:29 | 显示全部楼层 |阅读模式

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在没有空间的情况下,这种latch up 怎么修改
f74d22718a054bea062b00e4ab2a5cf.jpg
 楼主| 发表于 2024-2-2 11:38:08 | 显示全部楼层
本帖最后由 陈雪 于 2024-2-2 12:39 编辑

1706848725179.png 这是错误描述
发表于 2024-2-2 11:42:24 | 显示全部楼层


陈雪 发表于 2024-2-2 11:38
这是错误描述


这图片翻着的,过于离谱了。脖子断了
发表于 2024-2-2 11:51:18 | 显示全部楼层
我恨不得倒立过来看
发表于 2024-2-2 11:57:55 | 显示全部楼层
直连PAD的模块和内部模块分开,单独包环
发表于 2024-2-2 13:50:32 | 显示全部楼层
T_gen3 工艺里,你真接了IO pad N/PMOS, 这条你得修掉。
发表于 2024-2-2 13:50:42 | 显示全部楼层
能否提供更多的信息,例如绿色线报错位置的对象是都为同一个电位的器件吗?报错对象有什么类型的器件?全为Core Device吗?单纯一个报错无法了解怎么修改。
发表于 2024-2-2 13:58:06 | 显示全部楼层


发散性思维 发表于 2024-2-2 11:57
直连PAD的模块和内部模块分开,单独包环


怎么修:拉开距离,或者接 IO 的MOS接 200 ohm电阻, 这要看电路设计允许否。
1. NMOS 接IO, 则内部的pmos 与 此 Nmos 拉开到23um. 中间放电阻,电容,nmos都可以呀。

2. PMOS 接IO, 则内部的nmos 与 此 Pmos 拉开到23um. 中间放电阻,电容,pmos都可以。
发表于 2024-2-2 14:15:41 | 显示全部楼层
没间距也得给latch让间距
发表于 2024-2-2 16:22:57 | 显示全部楼层
仔细研读design rule吧
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