关于pipeline ADC有一个问题想不明白，求救

纪念殿下臣 · 发表于 2023-11-28 17:07:08

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在pipelined ADC的数字冗余位校正方法中比较器存在失调会造成误码。以2bit/位的子ADC为例，正的失调需要在数字结果中+1，而负的失调需要在数字结果中-1。为了避免判断会调整比较器判决电平，将判决电平增加1/4Vref，这样就可以避免判决而只需要在数字结果中做加法运算就可以了。

我怎么想都不明白这里为什么判决电平增加1/4Vref以后整体余量曲线右移就可以不再做判决了。。。右移以后我看余量曲线如果有负的失调不是依然还是会存在小于-1/2Vref的情况吗？这样不是依然要判决吗？

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