SSPLL锁定不了各模块单独仿真都没问题

qinkun · 发表于 2023-7-17 10:18:25

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感觉一会锁一下就锁不住了，然后又去锁，一段一段的，有大佬知道为啥吗

qinkun · 发表于 2023-7-17 10:27:47

感觉哪里在漏电一样，上升到一定程度，FLL就有重新开始工作

mismatch24 · 发表于 2023-7-17 11:21:00

你这就是没锁柱啊，先检查下环路参数吧

qinkun · 发表于 2023-7-17 14:28:41

mismatch24 发表于 2023-7-17 11:21
你这就是没锁柱啊，先检查下环路参数吧

是滤波器吗，ISSCP20u，Fref10M，滤波器10K，90p，30p

wkp1992101 · 发表于 2023-7-17 16:19:07

是一直没锁住，增大lpf的电容或者减小icp电流即可。原因是pfd比较的是时钟沿，举个例子比如说时钟沿一直慢，vc缓慢上升，直到锁住。出现的异常就是vc上升太快，时钟沿从慢直接跳过了相等过渡到快，vc就降低，然后又没锁住，又从快跳到了慢，如此重复，就是你这个现象。

qinkun · 发表于 2023-7-19 11:05:53

wkp1992101 发表于 2023-7-17 16:19
是一直没锁住，增大lpf的电容或者减小icp电流即可。原因是pfd比较的是时钟沿，举个例子比如说时钟沿一直慢 ...

大哥我现在在一些频率锁住了，但是还是有一些频率锁不住，这是因为什么啊？我怎么调电容都不行

模拟 · 发表于 2023-8-18 15:45:15

楼主，请问解决了么，我也出现这个问题

qinkun · 发表于 2023-8-29 15:07:10

模拟发表于 2023-8-18 15:45
楼主，请问解决了么，我也出现这个问题

解决了，还是得调整滤波器

Zj1228 · 发表于 2024-1-7 23:07:47

楼主好，你的环路滤波器是怎么计算的？有计算器吗？

qinkun · 发表于 2024-1-11 12:14:32

Zj1228 发表于 2024-1-7 23:07
楼主好，你的环路滤波器是怎么计算的？有计算器吗？

看着论文里算的

[求助] SSPLL锁定不了各模块单独仿真都没问题