SAR ADC的 DAC settling时间不够

major948 · 发表于 2023-5-28 06:47:19

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我试着做了一个桥接电容SAR，可能是因为桥接电容选的单位电容比较大，DAC要达到稳定的时间会比较长，我尝试增大了导通开关的尺寸，但对DAC稳定的时间没有明显的改善，请问大家在遇到DAC稳定时间过长的情况会怎么处理呢？（我使用的是异步SAR Logic，每次比较器重置完就会开始进行下一次比较，所以给DAC settle的时间不是很多）

DD_cebelas · 发表于 2023-5-29 00:45:17

redundancy

xuwenwei · 发表于 2023-5-29 17:13:52

异步不是比较完成才会进行下一步吗？

spartan313 · 发表于 2023-5-29 17:21:02

开关大了，ron会小但是寄生电容也会增加，还是降低unit cap 比较来的快

menglimeng · 发表于 2023-5-29 22:00:07

你是怎样看出DAC的settling时间不足的，依据是什么呢

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[求助] SAR ADC的 DAC settling时间不够

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