veriloga模型导入virtuoso出错，如下

WL8906 · 发表于 2023-2-26 18:02:38

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zixin1hao · 发表于 2023-2-26 18:02:39

WL8906 发表于 2023-3-11 13:15
换了13行的，还是显示语法错误，求指教

那就先不要这个attributes试试，它不影响功能

dongming · 发表于 2023-2-26 21:35:24

那不写着第13行编译出错，语法有误吗？

WL8906 · 发表于 2023-3-9 20:28:18

dongming 发表于 2023-2-26 21:35
那不写着第13行编译出错，语法有误吗？

这句话意思是第13行:编译失败，因为发现了无效的声明。要么声明中的标识符格式不正确或标识符已经在另一个声明中使用。使用另一个标识符并重新运行模拟。

小白不懂，请问您知道怎么改吗

zixin1hao · 发表于 2023-3-10 14:15:50

把attributes 放到parameter声明前面看看

WL8906 · 发表于 2023-3-11 13:15:55

zixin1hao 发表于 2023-3-10 14:15
把attributes 放到parameter声明前面看看

换了13行的，还是显示语法错误，求指教

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WL8906 · 发表于 2023-3-12 14:18:29

zixin1hao 发表于 2023-3-11 21:59
那就先不要这个attributes试试，它不影响功能

嗯嗯 attr里面‘info’识别不出来，都删了attr 这几行就没有错误了。非常感谢您。

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WL8906 · 发表于 2023-3-12 14:57:02

zixin1hao 发表于 2023-3-11 21:59
那就先不要这个attributes试试，它不影响功能

请问这个环境变量在哪儿啊？

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