寄存器模型期望值无法更新

薛定谔的青蛙 · 发表于 2023-1-29 07:47:26

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本帖最后由薛定谔的青蛙于 2023-1-29 08:00 编辑

想了很久没明白为什么同一个寄存器模型在同一时间get的期望值不一样。
我在virtual_seq使用寄存器模型进行了write操作，同时打印了寄存器名字和期望值：

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在scb tlm fifo的write（）函数中做了同样的操作

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最后打印结果如下，scb中打印结果始终为0，virtual_seq中能打印写入后更新的期望值。

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virtual_seq中的rgm继承于base_virtual_seq，来自timer_virtual_sequencer：

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scb的rgm和virtual_sequencer的rgm在env中进行了连接：

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薛定谔的青蛙 · 发表于 2023-1-30 16:29:04

终于解决了
寄存器模型要在write完之后才能更新，但是scb中调用imp的write时寄存器模型的write还没执行完。虽然仿真时间没变但也有先后。

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