萌新除法器优化设计求助

皖南坤势 · 发表于 2022-12-23 10:23:52

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大佬们好，小白在学习除法器设计，目前工程框架是一个8转64输入模块，一个64位除法器，一个64转8输出模块，目前是输入一个数据算一个，大佬们如果优化除法器速度该怎么优化呢？除法器是参考网上资料，目前暂时不能对除法器内部ALU重新优化设计。请问是对输入模块改为FIFO能起到优化效果吗，还是怎么做呢？小白不懂，大佬能不能指点一下思路。

皖南坤势 · 发表于 2022-12-23 10:37:48

不要沉啊

西门村村 · 发表于 2022-12-23 11:59:59

最简单的方法，一个除法器不够用，就多复用几个不就行了

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