virtuoso中verilog生成schematic，只有几个端口

applus · 发表于 2022-11-17 17:59:31

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我直接用import导入verilog文件就能直接生成正确的schematic，但是我用这个生成出来就只有几个端口，这是咋回事？企业微信截图_16686778809815.png

JChenne · 发表于 2022-11-18 13:18:36

这是库没对应上把，你看一下log文件的之类的，应该会有很多warning

applus · 发表于 2022-11-18 16:25:15

JChenne 发表于 2022-11-18 13:18
这是库没对应上把，你看一下log文件的之类的，应该会有很多warning

登录/注册后可看大图

但是他都显示这个了，应该是找到库里面的cell了。有一个warning：Multiple logical library mappings have been detected in the cds.lib.Directory used multiple times '/ic/projects/training/HP_Analog_Lib'.跟这个有关系吗？

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