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[求助] Source这是什么意思?

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发表于 2022-9-21 14:56:02 | 显示全部楼层 |阅读模式

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1663743305(1).png
各位大神。 是不是说我版图比线路图的线要多吗?
下面这个怎么又一样了?没看懂,


发表于 2022-9-21 14:58:08 | 显示全部楼层
这是layout里的数据和电路里的对比
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 楼主| 发表于 2022-9-21 15:06:17 | 显示全部楼层


   
이지은 发表于 2022-9-21 14:58
这是layout里的数据和电路里的对比


感谢大神回复,还有1个问题我想问一下,上面那个的意思是不是说我layout的线画多了。nets:507和398
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发表于 2022-9-21 15:12:16 | 显示全部楼层
看after transformation的数据
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 楼主| 发表于 2022-9-21 15:19:45 | 显示全部楼层


   
fengrlove 发表于 2022-9-21 15:12
看after transformation的数据


看不懂,我是超级小白。我刚学这个。
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发表于 2022-9-21 15:31:40 | 显示全部楼层
有时候可能存在下层block里的我们这一层是打散画的,就会出现多识别instance,就相当于本来人家电路就这一个block,我们是连block里面的一起调用的同一层连线,就会别我们版图里这些instance,不会识别到block,导致结果就是数据说版图少了一个模块,单多了好多器件和连线。但最后lvs,drc跑过就行了,这对不对的上都不要紧
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 楼主| 发表于 2022-9-21 15:36:18 | 显示全部楼层


   
이지은 发表于 2022-9-21 15:31
有时候可能存在下层block里的我们这一层是打散画的,就会出现多识别instance,就相当于本来人家电路就这一 ...


我懂了,谢谢。
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