pipelined adc simulink 仿真问题请教请教请教请教

lhlbluesky · 发表于 2008-1-8 23:59:08

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本帖最后由 eecsseudl 于 2013-4-29 09:57 编辑

在进行pipelined adc simulink 仿真时（10位每级1.5位），当施加了传输函数来表示MDAC的增益时（2p1/s+p1，p1为主极点），应该增加延时（unit delay），但是，仿真时现象很奇怪，我设定采样频率为1k hz，仿真时间为16.383，理论上，应该能采到16384个点，但实际的采样点数是7、8万多，且随着p1值的增大，采样的实际点数也增多，但是，当p1的值（理想为7000左右，不知道对不对）降低到800左右时，采样的点数就对了

我看了一下输出的采样时间，本应该每隔0.001s采样一次，但是，实际的仿真时间中有的步长小于0.001s，而且十分不规律，中间的步长很大，而两头的步长很小，输出的转移特性曲线不是阶梯（近似为一条直线），而是一个闭合的椭圆，正向与反向的2条曲线不能重合，而且差的很多

这个问题已经困惑了我快2周了，有没有那位达人能够帮忙指点一下，不胜感激！！
感恩涕零！！
谢谢先

scry · 发表于 2008-1-26 14:38:29

a little confused...

-- your transfer curive means MDAC transfer curve? or pipeline ADC transfer curve?
-- 1kHz*16.383S=16384 samples, sampled by ADC clock? or simulink step?

for ADC, sampled by clock is meaningful. If your data is sampled by simulink step, you should convert to data sampled by clock. I always use a diff function to find clock indices to perform the convertion.

foolish · 发表于 2008-12-23 21:46:22

学习学习

huajl8443 · 发表于 2008-12-23 23:51:50

已经是强人了啊

jiajia860101 · 发表于 2009-3-29 01:23:17

好好学习努力赚钱

jtking · 发表于 2010-9-17 18:14:13

学习~~起步阶段好难啊

wangyets98 · 发表于 2012-2-10 23:25:48

回复 1# lhlbluesky

你好，我现在在做流水线ADCsimulink建模，采样点也同样出了问题，想请教下。就是我下降沿触发模块做理想采样保持，直接送到workspace中，仿真一个周期，假如正常应该出来10个点，但是workspace中的数据出来了61个，不知道，怎么会采到这么多的点？