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要跑一个图像传感器,控制逻辑部分用Verilog写的,用vcs测试很快就出结果了,但加上模拟部分一起跑AMS就不行了,设置了200us,现在才跑几百ns
tran: time = 265.1 ns (88.4 m%), step = 40 ps (13.3 u%)
tran: time = 270 ns (90 m%), step = 20 ps (6.67 u%)
tran: time = 275 ns (91.7 m%), step = 2.46 ns (820 u%)
tran: time = 276.3 ns (92.1 m%), step = 640 ps (213 u%)
tran: time = 280.3 ns (93.4 m%), step = 160 ps (53.3 u%)
tran: time = 285.2 ns (95.1 m%), step = 80 ps (26.7 u%)
tran: time = 290 ns (96.7 m%), step = 20 ps (6.67 u%)
我刚学会软件不久,不知道跑这么长时间是合理的吗?或者verilog写的有问题?还是什么原因呀?求助各位大佬
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